
議程安排
13:00-13:20
簽到
13:20-13:30
開場致辭
13:30-14:15
高速總線發展趨勢及測試挑戰
14:15-15:00
PCIE 6.0 協議層測試及CXL 3.X 協議更新
15:00-15:20
茶歇和演示
15:20-15:50
PCIe5.0/6.0規范的概述以及物理層TX測試方法
15:50-16:20
PCIe ? 6.0接收端的Flit FEC分析
16:20-16:50
高速無源通道建模及校準-PCIE6 ? 時代對無源通道的挑戰
16:50-17:00
答題抽獎
-end-

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