過去十年，F(xiàn)PGA與芯片開發(fā)的主旋律是什么？
——流程重、驗(yàn)證慢、迭代貴。
很多工程師已經(jīng)默認(rèn)接受：寫RTL、跑仿真、上板調(diào)試、反復(fù)修bug，就是“行業(yè)常態(tài)”。
但問題是：AI算力在指數(shù)級(jí)增長(zhǎng)，產(chǎn)品節(jié)奏在按月計(jì)算，而你的開發(fā)流程，還是按“季度”甚至“流片周期”在走。
這件事，本身就不合理。
這一次，我們不聊概念，直接看方法。
?? 用 OpenClaw 重構(gòu) FPGA 與芯片開發(fā)流程
這不是一個(gè)“新工具介紹”，而是一套更激進(jìn)的工程范式：
你將看到——
為什么傳統(tǒng) FPGA 開發(fā)流程正在成為性能與效率的“雙瓶頸”
OpenClaw 如何打通「算法 → 硬件實(shí)現(xiàn) → 系統(tǒng)驗(yàn)證」閉環(huán)
芯片設(shè)計(jì)早期，如何把 80% 的問題消滅在流片之前
工程團(tuán)隊(duì)如何把開發(fā)周期，從“月級(jí)”壓縮到“周級(jí)”
更關(guān)鍵的是，這場(chǎng)直播會(huì)回答一個(gè)很現(xiàn)實(shí)的問題：
?? 下一代芯片開發(fā)，拼的到底是架構(gòu)能力，還是工具鏈能力？這種開發(fā)模式對(duì)國產(chǎn)FPGA有什么利好？工程師和學(xué)生還要學(xué)習(xí)什么？
????? 適合誰來：
被仿真/驗(yàn)證拖慢節(jié)奏的 FPGA 工程師
正在做 SoC / ASIC 設(shè)計(jì)的 IC 工程師
從事集成電路設(shè)計(jì)學(xué)習(xí)的高校學(xué)生和老師
做邊緣 AI / 高性能計(jì)算但被硬件開發(fā)卡住的團(tuán)隊(duì)
想把開發(fā)效率提升一個(gè)量級(jí)的人
如果你已經(jīng)厭倦“堆人、堆時(shí)間、賭流片”的開發(fā)模式，這場(chǎng)直播值得你花1小時(shí)認(rèn)真聽完。
真正拉開差距的，從來不是努力程度，而是方法代差。
而這一次，代差可能就在你要不要點(diǎn)開這場(chǎng)直播。
分享嘉賓：賴曉錚
華南理工大學(xué)計(jì)算機(jī)科學(xué)與工程學(xué)院，副教授。CCF會(huì)員，天工開物開源基金會(huì)理事。GitHub開源項(xiàng)目digiblock和PyChip作者。
長(zhǎng)期從事EDA與芯片設(shè)計(jì)工作，主持國家自然科學(xué)基金，國家863計(jì)劃重大科技專項(xiàng)，廣東省科技計(jì)劃，教育部中央高?；究蒲兄攸c(diǎn)項(xiàng)目，國家重點(diǎn)實(shí)驗(yàn)室開放基金等多項(xiàng)科研項(xiàng)目。
2021年度 教育部-華為“智能基座” 先鋒教師，2023年度 教育部-華為“智能基座” 棟梁之師，講授《計(jì)算機(jī)組成與體系結(jié)構(gòu)》課程獲2023年度華南理工大學(xué)-華為“智能基座”一流課程。
2020年指導(dǎo)學(xué)生獲得第四屆全國大學(xué)生集成電路創(chuàng)新創(chuàng)業(yè)大賽總決賽二等獎(jiǎng)， 2024年指導(dǎo)學(xué)生獲得第五屆集成電路EDA設(shè)計(jì)精英挑戰(zhàn)賽 （全國賽）一等獎(jiǎng)。
主持人：張國斌
電子創(chuàng)新網(wǎng)創(chuàng)始人兼CEO，西安電子科技大學(xué)電子工程專業(yè)畢業(yè)，半導(dǎo)體領(lǐng)域知名KOL。有多年的半導(dǎo)體媒體內(nèi)容與運(yùn)營經(jīng)驗(yàn)，撰寫過大量產(chǎn)業(yè)分析文章。（微信號(hào)：18676786761）
預(yù)報(bào)名獎(jiǎng)：20元京東E卡（10名）
通過小鵝通平臺(tái)填寫預(yù)約信息，我們將在所有預(yù)報(bào)名的用戶中隨機(jī)抽取10名，送出價(jià)值20元的京東E卡。
優(yōu)秀提問獎(jiǎng)：30元京東E卡（5名）
直播期間，在小鵝通平臺(tái)評(píng)論區(qū)參與提問，隨機(jī)抽取5名提問用戶，送出價(jià)值30元的京東E卡。
注
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