在當前高速電路設(shè)計中,高速芯片的供電電壓越來越低,信號的翻轉(zhuǎn)速率越來越快,集成度變得越來越高,而功耗變得越來越大,導致芯片對電源紋波噪聲的要求越來越嚴格,這就要求提前做好電源分配網(wǎng)絡(luò)的設(shè)計,以及準確、高效、便捷地進行紋波噪聲測試。
直播亮點預告
針對高速單板上進行紋波噪聲測試的多個痛點問題,本次直播將為您一一分解,讓大家測得更準,測得更方便,測得更高效。
電源完整性之PDN組成和電容的作用
- 電源分配網(wǎng)絡(luò)(PDN)介紹
- 直流壓降
電源完整性設(shè)計的目標和技巧
- 目標阻抗
- 電容在PDN阻抗設(shè)計中的作用
- 電容的安裝頻率和Fanout優(yōu)化
電源紋波噪聲測試常見問題及泰克解決方案
- 紋波噪聲的來源
- 測試系統(tǒng)的精度/帶寬/電壓偏置等要求
- 時域/頻域聯(lián)調(diào)
- 豐富的測試連接方式
- 板級紋波噪聲測試推薦配置
線上直播
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直播日程
時間
2020年7月10號(周五)14:30 - 16:00
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14:30-15:30 |
高速電路設(shè)計中的電源完整性測試 |
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15:30-15:45 |
互動與答疑 |
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15:45-16:00 |
有獎問答 |
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講師介紹
趙凱
泰克高級應用工程師
畢業(yè)于北京航空航天大學電子信息工程專業(yè),曾從事多年高速PCB設(shè)計,信號仿真建模等工作;2017年加入泰克,在泰克科技(中國)有限公司擔任高級應用工程師。
目前在泰克主要負責光通信、高速串行及半導體參數(shù)測試等相關(guān)行業(yè)的技術(shù)支持工作,支持的產(chǎn)品包括實時示波器,采樣示波器,信號源,半導體參數(shù)分析儀和相關(guān)解決方案。
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