Zynq-7000系列Quad-SPII/O接口簡介

接線連接

I/O 信號可通過 MIO 引腳獲得， Quad-SPI 控制器在共享或單獨的總線配置中最多支持兩個 SPI 閃存， 控制器支持以多種配置運行：

• Quad-SPI 單 SS、4 位 I/O

• Quad-SPI 雙 SS、8 位并行 I/O

• Quad-SPI 雙 SS、4 位堆疊 I/O

• Quad-SPI 單 SS，傳統 I/O

注意：如果要使用 QSPI 存儲器子系統，則 QSPI 0 應始終存在。QSPI 1 是可選的，僅在兩內存排列時才需要。因此，不能單獨使用 QSPI_1

單 SS，4 位 I/O

連接到控制器配置的 4 位閃存接口的框圖如下所示，此配置支持就地執行功能。

雙 SS，8 位并行

控制器最多支持兩個并行運行的 SPI 閃存，如圖所示，此配置將最大可尋址 SPI 閃存從 16 MB（24 位尋址）增加到 32 MB（25 位尋址），此配置不支持就地執行功能。

對于 8 位并行配置，數據字的偶數位位于低位存儲器中，而數據的奇數位位于高位存儲器中。控制器負責 I/O 和線性模式下的數據管理。Quad-SPI 控制器在將狀態數據寫入 RXFIFO 之前從兩個 Quad-SPI 設備和 OR（或操作）讀取兩個設備的狀態信息。

雙 SS、4 位堆疊 I/O

為了減少 I/O 引腳數，控制器還在共享總線配置中支持最多兩個 SPI 閃存，如下圖所示。

此配置將最大可尋址 SPI 閃存從 16 MB（24 位尋址）增加到 32 MB（25 位尋址），但吞吐量與單內存模式相同，請注意，在此配置中，不支持設備級 XIP 模式（讀取 0xBB 和 0xEB 指令代碼）。

如果使用線性 Quad-SPI 存儲器子系統，則應始終連接下層 SPI 閃存，上層閃存是可選的， 總地址空間為 32 MB，具有 25 位地址。

在 IO 模式下，地址的 MSB 由位于寄存器 0xA0 的第 28 位的 U_PAGE 定義。

在線性地址模式下，AXI 地址位 24 決定內存頁的高位或低位，所有命令都將由 U_PAGE 在 I/O 模式和地址位 24 中選擇的設備執行線性模式。

單 SS，傳統 I/O

Quad-SPI 控制器可以在傳統的單比特串行接口模式下運行，用于 1x、2x 和 4x I/O 模式，如圖所示。