VLSI26 重磅｜Intel 18A-P 全解析：RibbonFET+PowerVia ，18A-P 如何實現同頻省 18% 功耗？

2026 IEEE VLSI英特爾晶圓代工，由Intel 制程研發團隊完成實測披露《Intel 18A-P CMOS Technology Enhancement Featuring Advanced RibbonFET (GAA) Transistors and PowerVia》,18A-P制程介紹和痛點改進。

埃米核心制程時代，報告完整梳理 Intel 18 基礎工藝迭代升級方案 18A-P，覆蓋 GAA RibbonFET 晶體管革新、PowerVia 背面直接觸、多層 VT 器件、互連優化、熱管理、全維度可靠性六大板塊，精準面向 AI 大算力、高性能計算、移動端芯片當下功耗與頻率矛盾痛點。 

行業普遍卡在先進制程 “提速必加功耗” 的死循環，18nm 級 GAA 基礎工藝性能已逼近物理上限，AI 芯片超高電流密度帶來壓降、熱失效、器件漂移多重難題。這份 VLSI 官方實測報告完整給出 18A-P 全套制程改良方案，附帶海量晶圓電學、可靠性、熱學實測數據，清晰量化性能提升幅度，明確適配 Panther Lake、Nova Lake 新一代產品量產路線。

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第一部分：Intel 18A 工藝家族定位，18A-P 作為性能增強迭代節點

Intel 完整埃米時代制程矩陣分為 18A 基礎工藝、18A-P 高性能增強工藝、18A-PT 基底拓展工藝、遠期 14A 節點四大層級（Slide3-Slide4）。18A 基于初代 RibbonFET + 基礎 PowerVia 背面供電，2025 年已進入量產；而本次 VLSI 披露的 18A-P 是面向 HPC/AI 的專項增強版本，2026 年進入風險試產，專為超大算力芯片優化，同時完美向下兼容 18 全套設計庫，無改版成本。

核心迭代邏輯不依靠縮小柵極物理尺寸，而是通過晶體管結構、接觸方案、互連、熱管理四大維度協同改良，在 180nm、160nm 兩種標準單元高度庫下同步生效，兼顧高性能計算高密度單元與移動端低功耗單元兩類場景。

第二部分：RibbonFET 雙接觸革新，多層 VT 器件拓展，晶體管底層性能全面突破

18A-P 核心器件革新是前后雙面雙接觸 W3P 高性能 RibbonFET（Slide8-Slide17）：在原有正面源漏接觸基礎上新增 PowerVia 直連背面外延源極，消除電流聚集效應，NMOS 串聯電阻降低 12%、PM 串聯電阻降低 20%，載流遷移率顯著提升。實測環振頻率相比原版 18A 晶體管提升 12%，PMOS 驅動電流提升 16%、NMOS 提升 5%，且新增器件電容無額外增長，做到性能零面積代價。 

同時擴充完整多閾值體系：在原有 4 組 VT 基礎新增中間檔位，總計 5 組邏輯 VT，ULVT 閾值同步下調 10mV，器件工藝偏移波動縮小 33%，配套 W1.5 全新低功耗窄溝 RibbonFET，靈活平衡芯片頻率與漏電，適配從移動端超低功耗到 AI 超高算力全譜系芯片需求。應力薄膜工藝優化 PMOS 溝道壓應力，進一步放大空穴遷移率增益，是同功耗提速的核心底層支撐。

第三部分：18A-P PowerVia 背面供電 + 多層互連同步優化，壓降與 RC 雙重改善

晶體管性能釋放離不開互連與供電配套升級。互連層面，報告實測 V0/V1/V2 關鍵通孔層電阻降低 10%~30%，通過通孔幾何優化、配套金屬材料改良，大幅緩解先進節點金屬線電阻飆升帶來的時序損耗。 

供電體系依托成熟 PowerVia 架構迭代雙面接觸方案，背面直連路徑大幅縮短供電路徑，降低全局 IR 壓降；搭配整套優化熱傳導材料，芯片整體導熱性能提升 50%，解決 AI 芯片高密度晶體管堆疊局部熱點、熱擊穿難題。

整套互聯 + 供電改良無需改動原有掩?；A架構，現有 18A 設計文件可無縫移植至 18A-P 流片，大幅縮短產品開發周期。 

第四部分：全維度可靠性驗證，BT/GOX/ 熱載流子指標全部達標

18A-P 全套可靠性測試數據，即便采用雙面前后接觸結構，擊穿電壓、動態應力失效概率與 18 基礎工藝持平，未引入任何新型失效機制。

PMOS BTI 偏置退化壽命同步優化，NMOS GO 氧化層、熱載流子壽命均滿足高端芯片十年工作壽命規范，高低溫、電壓壓力下器件漂移可控，兼顧數據中心 AI 芯片 7×24 小時長時間穩定運行需求。熱管理配套全新 EDA 仿真流程與專用導熱結構，可精準預判高算力芯片熱點分布，提前布局散熱設計。

第五部分：量化性能收益與產品落地路線（對標先進光刻價值解讀寫法）

報告給出標準化 ARM 子塊實測硬指標（Slide6）：同等功耗下 18A-P 芯片最高頻率提升 9%；同等運行速度下整體功耗降低 18%，160nm 高密度庫、180nm 高性能庫兩套單元全部實現同等收益。

量產節奏清晰：18A 已 2025 量產，18A-P 2026 風險量產，全面支撐 Intel Panther Lake 高性能算力平臺、Nova Lake 移動端平臺新一代芯片開發，覆蓋 AI 加速器、數據中心 CPU、旗艦移動 SoC 全品類。

  結論分析：

當前大模型算力需求持續爆發，單純依靠光刻微縮成本極高，通過晶體管、供電、互連、熱管理協同工藝改良成為性價比最高的性能提升路徑。

報告以全套晶圓實測電學、熱、可靠性數據，完整拆解 Intel 18A-P 增強工藝全部創新點，清晰量化功耗、頻率、器件可靠性提升幅度，同時給出向下兼容的設計遷移方案。

完整展示 RibbonFET GAA+PowerVia 背面供電的埃米時代最優協同路線，為全球 AI 芯片、高性能計算設計廠商提供下一代先進制程選型權威參考，也指明未來 14nm 節點的迭代優化方向，先進制程軟硬件協同設計的生態合作價值愈發關鍵。

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