SysPro電力電子技術(shù)-技術(shù)前瞻

AI近端供電IVR電感技術(shù)的門檻：高頻Q值、大電流、高集成、封裝可靠性同時(shí)成立？

SysPro電力電子技術(shù)  |  參考來源：TAIYO YUDEN

這篇我們聚焦于：AI近端供電IVR金屬芯片功率電感與封裝集成。

老樣子，先說結(jié)論：集成穩(wěn)壓器的難點(diǎn)，不是缺少更激進(jìn)的電源拓?fù)?，而是缺少能在幾十MHz、高電流密度和低高度約束下穩(wěn)定工作的磁性器件。

當(dāng)供電從主板側(cè)走向背面、封裝側(cè)和芯片附近，電感會(huì)同時(shí)承受三個(gè)壓力：體積要縮小，頻率要升高，損耗和飽和又不能失控。金屬多層芯片電感的價(jià)值，就在于把材料、工藝和結(jié)構(gòu)設(shè)計(jì)放到同一個(gè)封裝集成坐標(biāo)系里。

圖片來源：TAIYO YUDEN  | 微處理器供電從分立VR走向近端供電

一、為什么近端供電會(huì)先卡在電感上？

AI處理器電流越來越大，傳統(tǒng)板級(jí)VR到負(fù)載之間的路徑損耗開始變得明顯。供電模塊往芯片附近移動(dòng)，確實(shí)能降低互連損耗，但也會(huì)把無源件推入更苛刻的空間。

過去電感可以作為板級(jí)標(biāo)準(zhǔn)件處理；進(jìn)入IVR和封裝近端供電后，它必須同時(shí)滿足低高度、高頻率、大電流和可陣列化。這個(gè)變化會(huì)直接改變磁件的設(shè)計(jì)邏輯。

圖片來源：TAIYO YUDEN  | 高頻無源件低高度化與Q值、Rdc、動(dòng)態(tài)損耗矛盾

不同IVR電感路線各有邊界。片上電感集成度高，但性能和成本不一定最優(yōu)；空氣芯可以避免磁性材料損耗，但電感密度有限；成熟多層金屬電感更像是在性能、成本和量產(chǎn)之間找平衡。

圖片來源：TAIYO YUDEN / APEC 2026 | IVR電感路線的性能、成本和市場(chǎng)階段比較

電感可以放在die side、land side、interposer、PCB embedded或PMIC module等位置。位置越靠近芯片，高度和端子就越敏感；位置越靠近PCB，裝配和散熱兼容性又會(huì)變成重點(diǎn)。

圖片來源：TAIYO YUDEN| IVR電感在芯片側(cè)、基板側(cè)和PCB嵌入中的布局選擇

二、金屬多層芯片電感的價(jià)值，是把材料做成平臺(tái)

金屬多層芯片電感的關(guān)鍵，不只是把材料換成金屬磁粉，而是把磁性材料、內(nèi)部電極、端子電鍍和層壓燒結(jié)工藝做成穩(wěn)定平臺(tái)。這樣才能派生出單顆、陣列、耦合、上下導(dǎo)通等不同結(jié)構(gòu)。

LSCN系列強(qiáng)調(diào)小尺寸、低高度、高電流能力和結(jié)構(gòu)定制能力。對(duì)IVR來說，這種可配置性比單顆器件參數(shù)更重要，因?yàn)椴煌蛻舻姆庋b空間和電流路徑并不相同。

圖片來源：TAIYO YUDEN / APEC 2026 | 金屬基多層功率電感LSCN系列定位和優(yōu)勢(shì)

多層工藝包含漿料、涂布、打孔、內(nèi)電極印刷、層壓、熱處理、端子電極和檢測(cè)等步驟。工藝流程越穩(wěn)定，越容易把磁件從樣品推向平臺(tái)化應(yīng)用。

結(jié)構(gòu)多樣性是這條路線的另一個(gè)重點(diǎn)。端子形態(tài)、陣列、二合一互耦、底部線圈和上下導(dǎo)通，不是外觀變化，而是為了適配不同PMIC布局、相數(shù)和封裝電流入口。

圖片來源：TAIYO YUDEN  | 多層金屬電感的端子、陣列和耦合結(jié)構(gòu)選擇

三、高頻大電流下，真正分水嶺是大信號(hào)評(píng)價(jià)

很多磁件在小信號(hào)掃頻下看起來不錯(cuò)，但進(jìn)入真實(shí)轉(zhuǎn)換器后，會(huì)遇到大電流紋波、直流偏置、溫升和磁性材料非線性。IVR電感如果只看小信號(hào)參數(shù)，很容易誤判實(shí)際效率。

熱處理金屬材料與普通金屬復(fù)合材料的差異，就在于顆粒間結(jié)合、填充密度和磁性連續(xù)性。它們會(huì)影響磁導(dǎo)率、飽和電流和高頻損耗，是薄型高電流電感能否成立的底層條件。

圖片來源：TAIYO YUDEN | 熱處理金屬材料與普通金屬復(fù)合材料結(jié)構(gòu)差異

不同電感方案在電感值、Rdc、飽和電流、Q值和封裝尺寸上的取舍非常明顯。對(duì)IVR來說，低Rdc和高Q值必須和高度、頻率、封裝位置一起判斷。

圖片來源：TAIYO YUDEN / APEC 2026 | LSCN與常規(guī)電感、復(fù)合芯和空芯方案對(duì)比

大信號(hào)評(píng)價(jià)被單獨(dú)提出，原因很簡單：真實(shí)VRM不是溫柔的小信號(hào)測(cè)試，而是高頻、大電流、有偏置、有溫升的工作狀態(tài)。Q值在真實(shí)激勵(lì)下能不能保持，才決定效率和熱邊界。

面向更高頻IVR，新材料方向希望在48MHz和高激勵(lì)電流下繼續(xù)維持Q值。這個(gè)趨勢(shì)說明，未來電感不只是更薄，還要在幾十MHz下保持可用的磁性和損耗特性。

圖片來源：TAIYO YUDEN | 面向高頻高激勵(lì)電流的新磁性材料方向

四、工程判斷：IVR電感會(huì)從標(biāo)準(zhǔn)件走向封裝協(xié)同件

從系統(tǒng)角度看，IVR電感的競(jìng)爭(zhēng)不再是單顆器件規(guī)格表競(jìng)爭(zhēng)，而是與PMIC、封裝基板、散熱和供電路徑協(xié)同的能力競(jìng)爭(zhēng)。

封裝工程師關(guān)心高度、端子、陣列、可靠性和可制造性；電源工程師關(guān)心電感值、Q值、Rdc、飽和和大信號(hào)損耗。金屬多層電感之所以值得關(guān)注，是因?yàn)樗瑫r(shí)觸碰了這兩組指標(biāo)。

圖片來源：TAIYO YUDEN  | 面向不同封裝位置的電感集成思路

未來AI近端供電繼續(xù)走向封裝內(nèi)或封裝旁邊，電感會(huì)成為決定IVR落地速度的關(guān)鍵器件之一。誰能把材料、工藝和結(jié)構(gòu)做成可復(fù)制平臺(tái)，誰就更容易進(jìn)入下一代處理器供電鏈路。

落到設(shè)計(jì)上，IVR電感至少要先確定三個(gè)邊界：目標(biāo)開關(guān)頻率、允許高度和最大紋波/偏置電流。頻率決定材料損耗權(quán)重，高度決定磁路能否連續(xù)，偏置電流決定飽和裕量。若只按電感值選型，很容易得到一個(gè)在實(shí)驗(yàn)室可測(cè)、但在封裝里不可用的器件。

還要注意端子和電流入口。近端供電中，電感端子位置會(huì)影響電流回路面積和寄生電感。上下導(dǎo)通、底部端子、陣列結(jié)構(gòu)不是外形差異，而是為了適配不同封裝電流路徑。,真正高水平的IVR磁件方案，需要電源、封裝和基板團(tuán)隊(duì)同步定義。

這也是為什么無源件正在從BOM尾部走到系統(tǒng)架構(gòu)前臺(tái)？電感如果跟不上，IVR的高頻化、薄型化和近端化都會(huì)被重新拉回現(xiàn)實(shí)邊界。

圖片來源：TAIYO YUDEN  | 微處理器供電從分立VR走向近端供電

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