Intel團隊：異構集成封裝 | Nature Reviews Electrical Engineering

未來產鏈 2026-05-07 17:59

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引言

隨著摩爾定律逐漸逼近物理極限，單純依靠晶體管尺寸微縮推動半導體產業發展的路徑愈發艱難，而異構集成（Heterogeneous Integration, HI）作為一種先進電子封裝方法，已被廣泛認為是后摩爾時代推動計算和通信領域持續發展的強大且關鍵的核心推動力。

異構集成通過將不同工藝、不同材料、不同功能的芯片組裝到同一平臺上，實現了計算、存儲和通信功能的系統級優化，打破了傳統單一芯片集成的局限，為電子設備性能提升、功耗降低和微型化發展提供了全新路徑。自2010年起，隨著2.5D/3D封裝等相關技術的逐步成熟，異構集成的價值在人工智能、高性能計算、智能手機及各類蜂窩通信產品的先進封裝應用中日益顯現，成為支撐這些領域技術突破的重要基石。

成果介紹

Intel先進封裝技術與制造部門負責人、美國工程院院士Ravi V. Mahajan就曾領銜十余所頂尖高校，從產學研協同視角發表異構集成路線相關觀點文章，推動技術交流與產業協同。基于此，本研究結合領先的先進封裝實例，系統梳理異構集成的價值、進展與發展機遇，詳細介紹人工智能、智能手機及其他蜂窩通信設備及其組成模塊（包括互連、電力電子、光子學、熱管理、可靠性、建模和共設計）的相關參數，旨在促進學術界、研究實驗室和產業界之間的深度合作，為異構集成技術的進一步發展與應用提供支撐。

圖文解析

圖 1 | 美國數據中心電力消耗的歷史與預測趨勢

AI 工作負載是異構集成最迫切的驅動力。AI 算力需求每 3 個月翻一番，遠超能效每年約 40% 的提升速度。美國數據中心電力消耗從 2014 年的 60–70 TWh 升至 2022 年的 176 TWh，預計 2028 年將達 325–580 TWh，占全美用電量的 6.7%–12%。核心瓶頸在于存儲：跨越馮·諾依曼計算-存儲架構的數據搬運能耗巨大，即便采用共封裝高帶寬存儲器（HBM），問題仍未根本解決。DRAM 密度在 10 nm 節點附近趨于停滯，單元周期時間仍超過 10 ns，限制了聚合帶寬。異構集成通過垂直堆疊存儲與邏輯芯片，將互連長度從厘米級縮短到毫米以下，同時為鐵電和自旋電子等新型存儲器件的集成提供了路徑。

圖 2 | 智能手機功能演進與高密度封裝集成

智能手機同樣依賴異構集成。每一代產品在厚度不變甚至更薄的前提下不斷疊加新功能，處理器模組總厚度已壓縮到 1 mm 以下。5G 的加入更帶來多天線、多調制解調器的集成需求。文章指出，5G 截至 2025 年尚未完全兌現其承諾，其全球部署率僅 40%–50%，毫米波部署有限，數據速率提升不明顯，增強現實、遠程手術等殺手級應用仍未落地。未來 6G 頻段（100–300 GHz）的封裝挑戰才剛剛開始。

圖 3 | 低功耗與高功耗電子的供電網絡架構

圖 4 | GPU 晶體管數量、硅面積與封裝功耗演進

作者指出，現有的異構集成路線圖雖然勾勒了技術全貌，但存在兩個主要不足：缺少量化屬性的系統預測，且未清晰闡述關鍵研究挑戰。文章圍繞互連、集成光子、集成電力電子、熱管理、可靠性、協同設計和建模仿真七個方向，逐一分析了需要補充的路線圖內容。例如，混合鍵合（hybrid bonding）相比傳統焊料互連可提升 625 倍的互連密度和 15 倍的能效；高功耗場景下電源效率需從約 70% 提升至 90% 以上；晶體管數量預計在 2030 年代初突破一萬億，液冷乃至芯片內部介電液浸入將成為必要的散熱手段。