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先講個(gè)真實(shí)案例:去年有個(gè)朋友做USB3.0設(shè)備,信號(hào)老是斷斷續(xù)續(xù)的,折騰了兩周才發(fā)現(xiàn)是差分線阻抗沒控制好。然后重新打板子就好了,耽誤了項(xiàng)目進(jìn)度,老板臉都綠了...

你看,差分阻抗控制不好,錢包和心情都會(huì)很糟糕。對(duì)于USB3.0這種高速接口(理論上是5Gbps,相當(dāng)于625MB/s),差分線的阻抗匹配簡直就是生命線。它直接影響著:
1、信號(hào)完整性:阻抗不匹配會(huì)導(dǎo)致信號(hào)反射,眼圖閉合。
2、傳輸質(zhì)量:可能引起數(shù)據(jù)錯(cuò)誤、連接不穩(wěn)定
3、EMI性能:差模噪聲增加,可能影響電磁兼容測試。
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這里以表層走USB線的差分微帶線阻抗模型的參數(shù)進(jìn)行描述

看中間PCB示意圖,對(duì)著右邊需要填寫的數(shù)據(jù),咱們挨著來解釋一下:
H1:半固化片的介質(zhì)厚度,是PCB的關(guān)鍵材料,它是走線層和參考層的距離(是固定參數(shù),由板廠提供);
Er1:介電常數(shù),(是固定參數(shù),由板廠提供);
S1:差分線的線間距(可更改);
W1:差分信號(hào)線的底層寬度(可更改);
W2:差分信號(hào)線的頂層寬度(可更改);
T1:走線的銅厚(一般為1盎司,也就是35μm或1.4mil);
以上疊層可根據(jù)實(shí)際模型進(jìn)行選擇,他們之間的關(guān)系可通過參數(shù)調(diào)整嘗試。
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假設(shè)我們使用常見的4層板結(jié)構(gòu):

頂層:信號(hào)層
第二層:完整地平面
第三層:電源層
底層:信號(hào)層
1、選擇模型:"Edge-Coupled Microstrip 1B"(表層差分微帶線模型)

2、填寫參數(shù):
H1(介質(zhì)厚度):4.2mil;
Er1(介電常數(shù)):FR4板材通常為4.2mil;
W1(線寬):這個(gè)我們先猜個(gè)值,比如6mil;
W6(線寬):假如也是6mil;
S1(線間距):先設(shè)8mil;
T1(銅厚):走線的銅厚(一般為1盎司,也就是35μm或1.4mil);
C1/C2/C3(基材走線的阻焊層):一般1mil;
CEr(阻抗的介電常數(shù)):4.2mil
3、目標(biāo)阻抗設(shè)為90Ω,點(diǎn)擊計(jì)算!

第一次計(jì)算可能不準(zhǔn)確,需要微調(diào):
如果阻抗偏高:可以適當(dāng)增加線寬或減小線距;
如果阻抗偏低:減小線寬或增加線距;
最后盡可能達(dá)到90Ω目標(biāo)阻抗,雖然差分線阻抗已經(jīng)設(shè)計(jì)出來,但不是最終結(jié)果,還要考慮等長設(shè)計(jì)。等長可以采用單端走蛇形線的方法,做到等長匹配。
別忘了咨詢PCB廠家:
他們的最小線寬/線距能力(一般5mil/5mil沒問題)
實(shí)際介電常數(shù)可能有偏差(建議要廠家提供測試數(shù)據(jù))
銅厚的實(shí)際值(加工后可能不是精確的1oz)
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計(jì)算好了只是開始,實(shí)際布線時(shí)還有這些坑要避開:
1、等長處理:盡可能等長;
2、避免銳角:轉(zhuǎn)彎用45°或圓弧,別玩直角漂移;
3、遠(yuǎn)離干擾源:別和時(shí)鐘線、電源線擠在一起;
4、過孔處理:盡量減少過孔,必須用時(shí)旁邊加接地過孔。

Q:阻抗一定要精確到90Ω嗎?
A:±10%通常可以接受。
Q:4層板和6層板設(shè)計(jì)有區(qū)別嗎?
A:有!介質(zhì)厚度不同,需要重新計(jì)算。6層板通常有更薄的介質(zhì)層,線寬可能需要調(diào)整。
Q:差分線可以換層嗎?
A:可以,但需注意:每個(gè)過孔都會(huì)引入阻抗不連續(xù),要盡量減少,過孔旁邊必須加地孔,換層時(shí)參考面會(huì)變化,需保證回流路徑順暢。
小結(jié)
記住,好的差分線設(shè)計(jì) = 準(zhǔn)確計(jì)算 + 謹(jǐn)慎布線 + 充分驗(yàn)證。第一次可能覺得復(fù)雜,多做幾次就會(huì)像騎自行車一樣自然了。
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最后提醒:投板前可以把設(shè)計(jì)參數(shù)發(fā)給PCB廠家確認(rèn)。
大家有什么USB設(shè)計(jì)中的趣事或問題,歡迎在評(píng)論區(qū)分享交流!


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